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PCB抗ESD設(shè)計(jì)規(guī)則

本文檔由 xkly 分享于2008-10-13 10:29

PCB抗ESD設(shè)計(jì)規(guī)則:ESD(靜電放電)是危害電子產(chǎn)品的潛在因素，在PCB設(shè)計(jì)中可以比較直接的避免ESD危害。本文先從ESD產(chǎn)生的機(jī)理說起，然后介紹了如何在PCB設(shè)計(jì)中通過隔離，屏蔽，引流等技術(shù)使ESD對(duì)電子產(chǎn)品危害降到最低。
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行業(yè)資料  —  輕工業(yè)/手工業(yè)
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PCB ESD 設(shè)計(jì) 電弧 聚酯薄膜 連接器 機(jī)箱 電流 電路 導(dǎo)體
系統(tǒng)標(biāo)簽：
esd pcb 機(jī)箱 規(guī)則 電弧 屏蔽
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